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AI가 자동으로 큐레이션·번역·정리하는 기술 동향 피드입니다.
arXivAI 번역논문
ObfAx: 근사 회로(Approximate Circuits)에서의 난독화 및 IP 복제 탐지
본 연구는 근사 회로(Approximate circuits)의 지적 재산(IP)을 보호하기 위한 새로운 위협 모델인 '근사 난독화(approximate obfuscation)'를 제안하고 이를 탐지하는 프레임워크를 다룹니다. 공격자가 설계 구조를 숨기면서도 원본과 유사한 오류 특성을 유지하도록 만드는 위협에 대응하여, 통계적 오류 프로파일을 비교함으로써 IP 도용을 체계적으로 탐지하는 방법을 제시합니다.
5월 20일1
arXivAI 번역논문
재구성 가능한 컴퓨팅 과제: 거대 과학의 온라인 이벤트 선택을 위한 실시간 그래프 신경망 (Graph Neural Networks)
본 연구는 거대 과학 실험의 실시간 이벤트 선택을 위해 AMD Versal VCK190 플랫폼에서 Graph Neural Networks(GNN)를 효율적으로 배포하는 방법을 제시합니다. FPGA 패브릭과 AI Engine 타일을 동시에 활용하는 반자동 설계 흐름을 통해, 기존 FPGA 전용 솔루션 대비 처리량을 53% 향상시키고 지연 시간을 7.15마이크로초로 최적화했습니다.
5월 20일1
arXivAI 번역논문
보안 하드웨어 설계 및 관련 문제를 위한 LLM: 기회와 도전 과제
LLM을 EDA 및 하드웨어 보안 설계에 통합함으로써 RTL 코드 생성과 테스트벤치 자동화 등 반도체 설계 프로세스의 혁신이 가능해졌습니다. 하지만 데이터 오염, 적대적 머신러닝 회피, 데이터 암기 등 심각한 보안 취약점도 함께 발생하고 있습니다. 본 리뷰는 최신 기술적 돌파구와 함께 이를 해결하기 위한 레드팀 활동 및 동적 벤치마킹 등의 대응책을 심층적으로 분석합니다.
5월 20일0
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Sieve: 진화하는 Mixture-of-Experts 모델을 위한 동적 전문가 인식 PIM 가속 기술
MoE 모델의 토큰-대-전문가 분포가 양봉형으로 변함에 따라 발생하는 기존 PIM 시스템의 효율성 저하 문제를 해결하기 위한 새로운 기술을 제안합니다. Sieve는 런타임 토큰 분포에 따라 GPU와 PIM 간의 전문가 실행을 동적으로 분할하고, 연산과 통신을 중첩시켜 처리량을 최적화합니다. 실험 결과, 주요 MoE 모델에서 기존 PIM 시스템 대비 최대 1.6배의 처리량 및 상호작용성 향상을 입증했습니다.
5월 20일2
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TLX: 대규모 프로덕션 환경을 위한 하드웨어 네이티브 및 진화 가능한 MIMW GPU 컴파일러
TLX는 현대 GPU의 복잡한 하드웨어 유닛과 비동기 메커니즘을 효율적으로 제어하기 위해 개발된 MIMW(Multi-Instruction, Multi-Warp) 기반의 GPU 컴파일러 확장입니다. Triton의 생산적인 블록 프로그래밍 모델을 유지하면서도 워프 그룹 단위의 세밀한 조율을 가능하게 하여, 데이터 이동과 텐서 코어 연산 최적화를 지원합니다. 실제 대규모 학습 및 추론 프로덕션 환경에서 성능과 커스터마이징 유연성을 입증하였습니다.
5월 20일0
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FPGA 기반 뉴로모픽 엣지 컴퓨팅을 위한 오픈 소스 순환 SNN 가속기를 통합한 이기종 SoC
본 연구는 엣지 디바이스를 위한 저전력·고효율 연산을 목표로 FPGA 기반의 이기종 SoC를 제안합니다. 오픈 소스 순환 SNN 가속기인 ReckOn을 RISC-V 기반 X-HEEP 및 ARM 프로세서와 통합하여, 실리콘 테이프 아웃의 비용 부담 없이 유연하고 비용 효율적인 뉴로모픽 시스템 구현 가능성을 검증했습니다.
5월 20일1
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재사용 인지형, 근접 메모리, 올-디지털 Ising 머신에 대한 상세 알고리즘 연구
본 논문은 SRAM 기반의 PIM(Processing-in-Memory) 기술을 활용하여 CPU의 L1 캐시를 재목적으로 활용하는 올-디지털 Ising 아키텍처인 SACHI를 제안합니다. SACHI는 ADC/DAC 회로 없이도 기존 하드웨어 오버헤드를 최소화하며, 기존 방식 대비 높은 신뢰성과 에너지 효율성을 제공합니다. 실험 결과, 자산 배분 및 외판원 문제 등 다양한 응용 분야에서 기존 방식보다 최대 300배의 성능 향상과 80배의 에너지 절감을 달성했습니다.
5월 20일1
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FPGA 가속 기반 잠금 관리 및 트랜잭션 처리: 아키텍처, 최적화 및 설계 공간 탐색
CPU 기반 OLTP 시스템의 낮은 잠금 서비스 효율성을 해결하기 위해 FPGA를 활용한 하드웨어 가속 잠금 관리 및 트랜잭션 처리 아키텍처를 제안합니다. 제안된 시스템은 DRAM 액세스 오버헤드를 줄이기 위해 잠금 테이블이 통합된 전용 하드웨어 에이전트를 사용하며, TPC-C 벤치마크 결과 CPU 대비 최대 51배의 처리량 향상을 달성했습니다.
5월 20일1
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NL-to-SVA 생성을 위한 개방형 속성 동등성 검증기를 활용한 보상 가중 온-폴리시 증류 (Reward-Weighted On-Policy
기존의 지도 미세 조정(SFT) 방식이 SVA의 논리적 정확성보다 토큰 모방에 치중하는 문제를 해결하기 위해 RWOPD(Reward-Weighted On-Policy Distillation) 기법을 제안합니다. 이 방법은 SymbiYosys+Z3 검증기를 통해 속성 동등성을 확인하고, 검증을 통과한 샘플에 대해 교사 모델의 지식을 증류하여 모델의 논리적 정확도를 높입니다. 이를 통해 Qwen2.5-Coder-7B-Instruct 기반의 CodeV-SVA-14B 모델은 기존 SOTA 모델 및 대규모 범용 모델을 능가하는 성능을 달성했습니다.
5월 20일4
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에이전트형 AI는 실제 하드웨어 엔지니어링을 수행할 준비가 되었는가? Phoenix-bench를 통한 심층 분석
본 연구는 소프트웨어 엔지니어링용 에이전트 AI를 하드웨어 엔지니어링 분야로 확장할 수 있는지 검증하기 위해 새로운 벤치마크인 Phoenix-bench를 제안합니다. 실험 결과, 하드웨어의 신호 흐름(Signal Flow) 특성으로 인해 기존 소프트웨어 최적화 에이전트들은 성능이 크게 저하되었으며, 단순한 위치 파악보다 정확한 수정 방향을 제시하는 피드백이 해결률 향상에 더 효과적임을 밝혀냈습니다.
5월 20일0
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Massive MIMO 실외 위치 측정을 위한 적응형 Transformer 가속기의 효율적인 구현
5G Massive MIMO 환경에서 10ms 미만의 실시간 위치 측정을 위해 설계된 적응형 Transformer 가속기 구현에 관한 연구입니다. 빔-지연 채널의 희소성을 활용한 행 단위 스킵 메커니즘과 혼합 데이터플로우 아키텍처를 통해 에너지 효율과 연산 속도를 동시에 개선했습니다. Xilinx Zynq UltraScale+ FPGA를 통해 검증된 이 시스템은 정확도 저하를 최소화하면서도 높은 처리량과 저지연 성능을 보여줍니다.
5월 20일1
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동적 비전 센서(DVS)를 위한 멤리스터(Memristor) 기술: 비판적 평가 및 연구 로드맵
Edge-AI의 에너지 병목 현상을 해결하기 위해 이벤트 기반 비전 센서(DVS)와 멤리스터 기반 인메모리 아날로그 컴퓨팅을 결합하는 기술을 분석합니다. 현재 기술 성숙도가 낮은 상태이며, 로보틱스 및 자율 주행 등 다양한 응용 분야에서 실질적인 시스템 통합을 위한 연구 로드맵과 프레임워크가 필요함을 강조합니다.
5월 20일1
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시간 영역 근접 메모리 컴퓨팅 엔진 (Time Domain Near Memory Computing Engine)
AI 워크로드의 에너지 효율을 높이기 위해 데이터 이동을 최소화하는 시간 영역(Time-domain) 근접 메모리 컴퓨팅 아키텍처를 제안합니다. 기존 아날로그 방식의 DAC/ADC 오버헤드 문제를 해결하기 위해 디지털 친화적인 인터페이스를 유지하면서 시간 영역에서 곱셈-누산(MAC) 연산을 수행합니다. 실험 결과, 40 MHz 동작 주파수에서 7.62 TOPS/W의 높은 에너지 효율을 달성하였습니다.
5월 20일1
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A3D: 자율적인 가속기 설계를 위한 에이전트 기반 AI (Agentic AI) 워크플로우
A3D는 하드웨어 가속기 설계를 자동화하기 위해 에이전트 기반 AI 워크플로우를 제안하는 연구입니다. 워크로드 분석부터 마이크로 아키텍처 생성까지의 전 과정을 자동화하며, 전문 에이전트 간의 협업과 Agentic RAG를 통해 복잡한 과학 애플리케이션의 가속기 설계를 인간의 개입 없이 수행합니다.
5월 20일1
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ITHICA: 결함 유발 침묵 데이터 오염(SDC)을 위한 스레드 내부 명령어 검사 방식
ITHICA는 실리콘 제조 결함으로 발생하는 침묵 데이터 오염(SDC)을 탐지하기 위해 명령어 중복과 출력 비교를 활용하는 새로운 스레드 내부 명령어 검사 방식입니다. 동일한 명령어를 실행하더라도 실행 컨텍스트에 따라 결과가 달라질 수 있다는 점을 이용하여, 임의의 프로그램을 결함 탐지용 기능 테스트로 자동 변환합니다. 3,000대 이상의 CPU 서버 테스트 결과, 기존 방식보다 39% 더 많은 결함 서버를 탐지하는 성능을 입증했습니다.
5월 20일2
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ICP: 불규칙한 메모리 액세스 프리페칭을 위한 명령어 상관관계 활용
본 논문은 불규칙한 메모리 액세스 패턴을 효율적으로 처리하기 위해 명령어 수준의 상관관계를 활용하는 새로운 하드웨어 프리페칭 메커니즘인 ICP를 제안합니다. 기존 시계열 프리페처가 주소의 재발에 의존하여 큰 저장 오버헤드를 발생시키는 것과 달리, ICP는 주소를 생성하는 명령어 간의 안정적인 데이터 의존 관계를 학습하여 미래의 액세스를 예측합니다. 실험 결과, ICP는 기존 프리페처 대비 높은 성능 향상을 보이면서도 하드웨어 저장 공간 요구량을 획기적으로 줄였습니다.
5월 20일1
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AI 하드웨어의 면적 효율성 향상을 위한 SRAM 기반 디지털 맞춤형 연산 엔진
본 논문은 인메모리 컴퓨팅(IMC) 시스템의 라우팅 문제를 해결하기 위해 10T SRAM 셀과 전가산기를 통합한 새로운 디지털 맞춤형 연산 엔진 아키텍처를 제안합니다. 이 설계는 이진 신경망(BNN)의 XNOR 연산에 최적화되어 있으며, 기존 CMOS 설계 대비 면적 효율성을 2.67배 향상시켰습니다.
5월 20일1
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TTP: 레이 트레이싱 (Ray Tracing)의 정밀한 프리페칭 (Prefetching)을 위한 하드웨어 효율적 설계
레이 트레이싱의 핵심 병목 현상인 BVH 순회 과정에서의 메모리 지연 시간을 해결하기 위해 새로운 하드웨어 프리페처인 TTP를 제안합니다. TTP는 RT 유닛의 기존 트리 순회 스택을 활용하여 매우 높은 정확도로 노드 데이터를 미리 가져옴으로써 메모리 대역폭 문제를 완화합니다. 시뮬레이션 결과, 하드웨어 오버헤드를 최소화하면서도 베이스라인 대비 최대 1.89배의 성능 향상을 달성했습니다.
5월 20일2
arXivAI 번역논문
근접 메모리 아키텍처를 사용하여 희소성, 면적, 에너지, 데이터 이동을 고려한 ILP 가속에 관한 종합적인 연구
본 논문은 정수 선형 계획법(ILP)의 높은 희소성과 분기 집중 문제를 해결하기 위해 근접 메모리 아키텍처 기반의 가속기인 SPARK를 제안합니다. SPARK는 기존 CPU의 L1 캐시를 재목적화하여 최소한의 하드웨어 오버헤드로 희소성 인식 연산과 데이터 이동 최적화를 수행합니다. 실험 결과, 기존 CPU 및 GPU 대비 성능은 최대 20배 향상되었으며 에너지 효율은 대폭 개선되었습니다.
5월 20일1
arXivAI 번역논문
ADS-IMC: 인메모리 컴퓨팅 (In-Memory Computation)을 통한 데이터 정렬 가속화
본 논문은 데이터 이동으로 인한 지연 시간과 에너지 오버헤드를 줄이기 위해 메모리 패브릭 내에서 직접 정렬을 수행하는 새로운 ADS-IMC 아키텍처를 제안합니다. 6T SRAM을 활용한 인메모리 정렬 방식을 통해 오프칩 데이터 전송을 제거하며, 기존 멤리스터 기반 IMC 방식보다 지연 시간을 3.4배 단축했습니다.
5월 20일1