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IBM이 1nm 미만 칩 아키텍처를 공개하며 AI 컴퓨팅 수요에 대응하는 하드웨어 전략을 강화합니다. 3D 나노스택 기술을 통해 트랜지스터 밀도를 높이고 성능과 에너지 효율을 대폭 개선할 계획입니다.
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원문 바로가기International Business Machines Corp (NYSE:IBM)은 1나노미터(nm) 미만의 칩 아키텍처를 특징으로 하는 새로운 반도체 기술을 공개했으며, Wedbush 분석가들은 이를 인공지능 (AI) 컴퓨팅 수요가 계속 증가함에 따라 칩 스케일링 (scaling) 측면에서 중요한 단계로 보고 있습니다.
IBM은 이 1nm 미만 설계가 손톱 크기 정도의 칩에 약 1,000억 개의 트랜지스터를 포함하고 있다고 밝혔으며, 분석가들은 이것이 회사의 현재 2nm 기술보다 약 두 배 높은 밀도라고 언급했습니다. 이 아키텍처는 밀도를 높이고 성능 효율성을 개선하기 위해 트랜지스터를 수직으로 쌓고 엇갈리게 배치하는 3D "나노스택 (nanostack)" 접근 방식에 기반합니다.
Wedbush 분석가들에 따르면, 이 새로운 설계는 IBM의 2nm 칩과 비교했을 때 최대 50% 더 높은 성능 또는 최대 70% 더 나은 에너지 효율을 제공하는 것을 목표로 합니다. 그들은 이러한 개선 사항이 처리 능력과 에너지 효율에 대한 수요가 계속 증가하고 있는 생성형 AI (generative AI), 클라우드 인프라 (cloud infrastructure), 차세대 전자 기기 전반의 워크로드 (workloads)를 지원할 수 있다고 기술했습니다.
또한 분석가들은 IBM이 나노스택 아키텍처를 사용하여 SRAM에서 40%의 스케일링 개선을 입증했다고 강조했으며, 이는 칩 설계자들이 AI 애플리케이션과 관련된 더 높은 대역폭의 데이터 흐름을 처리할 수 있는 더 효율적인 프로세서를 구축할 수 있게 해줄 것이라고 썼습니다.
Wedbush 분석가들은 IBM이 실리콘 설계, AI 중심 하드웨어, 로직 시스템 (logic systems), 그리고 양자 컴퓨팅 (quantum computing)에 이르는 노력을 통해 첨단 반도체 개발의 핵심 플레이어로 계속 자리매김하고 있다고 기술했습니다. 그들은 IBM이 고수치 개구부 (high numerical aperture) EUV 공정 및 관련 툴링을 지원하기 위해 첨단 리소그래피 (lithography) 기술 분야의 ASML을 비롯하여 Lam Research, Tokyo Electron, SCREEN Semiconductor Solutions 등 다양한 산업 파트너와 협력하고 있다고 언급했습니다.
분석가들은 이러한 파트너십이 초기 단계의 작동 가능한 장치(working devices) 개발에 기여했으며, 향후 10년 동안 반도체 로드맵(roadmap)을 확장하기 위한 IBM의 지속적인 첨단 공정 개발 노력을 반영한다고 기술했습니다. 또한, 리소그래피 (lithography) 및 트랜지스터 아키텍처 (transistor architecture) 분야에서의 진전이 AI 관련 하드웨어 시장에서의 입지를 강화할 수 있다고 덧붙였습니다.
반도체 개발 외에도, IBM은 Anderon이라 불리는 독립적인 양자 파운드리 (quantum foundry) 사업을 설립할 계획이라고 발표했습니다. Wedbush 분석가들은 이 엔티티가 IBM의 기존 양자 컴퓨팅 (quantum computing) 및 반도체 기술 전문성을 활용하여 국내 양자 웨이퍼 (quantum wafer) 제조 역량을 지원하는 것을 목표로 한다고 기술했습니다.